最近看了一个新闻，说2019年将会发布PCIE5.0标准，接口带宽将达到128GB/S，总线频率达到了32GHz
daikuan.jpg (121.22 KB, 下载次数: 2)
这里就有一个小疑问，PCI时代的33MHz，133MHz都容易理解，到了PCIE时代，用100MHz基准频率通过PLL锁相环倍频得来的总线频率，动不动就是几G甚至几十G，这样高的总线频率是真实在线路中运行的，还是只是相对基准频率的一个等效数据？
如果是真实存在的频率，尽管差分信号的低干扰和抗干扰都很强，但在CPU都很难突破10G的前提下，还是很难想像如何在接口间传输这样高频率的信号，从电气性能上来说可能达到32GHz这样的频率吗？
如果是等效数据的话，那是用了什么方法达到了如此高的等效频率的？PCIE接口上实际传输信号的频率始终都是100MHz的基准频率么？还是采用了类似内存的分频功能？但内存的接口频率貌似都是和内存频率一致的，也就是说现在4000MHz的内存，接口也都是传输4GHz的信号了？
可能问得非常不专业，无奈网上资料太少，我会尽量清晰表达，请大神帮忙
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https://zhidao.baidu.com/question/542260606.html
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早看过了，然而并没有解答我的问题
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这些频率是PLL由reference clock产生的 例如PAM4里面的PLL output clock就是28GHz
serdes serializer/deserializer需要的clock就是PLL的output clock
理论上来说CMOS工艺可以达到上百GHz RF/SOI可以达到两百甚至三百GHz
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从芯片的角度说还比较容易理解 ，但从物理接口方面呢，布线和插槽要传输32GHz的信号是不是需要一些例如屏蔽什么的特殊设计？ 还是这个频率对串行通讯的稳定性来说仍有很大余量？
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我觉得正常的高速差分信号布线方法就可以 具体可以百度
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这个和ddr一样，应该是等效频率
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学习，我也想搞明白这个问题 电路 电子 维修 我现在把定影部分拆出来了。想换下滚，因为卡纸。但是我发现灯管挡住了。拆不了。不会拆。论坛里的高手拆解过吗？ 评论 认真看，认真瞧。果然有收 电路 电子 维修 求创维42c08RD电路图 评论 电视的图纸很少见 评论 电视的图纸很少见 评论 创维的图纸你要说 版号，不然无能为力 评论 板号5800-p42ALM-0050 168P-P42CLM-01
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