近日闲着无事，店里没什么生意，于是对以前收集的资料进行分析，无意看中了A55的时序，在映像中徐总以前发过一篇帖子讲的就是时序，但是对VCORE_NB和APU_VDDPA/B（APU_VDDPA 和 APU_VDDPB 为方便就简写下，实际上为2个信号）这两个信号具体的定义一直模糊不清，于是在论坛搜索了很多帖子，有很多说法，这里给出徐总的定义，如下图
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先说下LLANO，是一种计算机用语，Sabine平台技术，Llano是即将上市的A系列APU，采用32nm工艺
在上图的右上角有这样一段话：
Single shared VDDNB Plane between GPU,UVD,Graphics memory controller and Northbridge 意思就是在GPU 、UVD 、图形内存控制器 、北桥之前共享VDDNB且是唯一的，（这里的图形内存控制器 ≠ 内存控制器，是GPU显存），但VDDNB 是否就是VCORE_NB？上一张GA-A55M-DS2的图，如下
如图，VDDNB是为脚位定义，明显是同一种意思。因此VCORE_NB（VDDNB）不对内存控制器供电，ATX的+3V + 5V给主板的多数元件供电的话，那么如果把APU比作ATX，VCORE_NB（VDDNB）就有些类似+3V +5V
这样，就剩 APU_VDDPA/B （APU_VDDPA 和 APU_VDDPB）了，先上 GA-A55M-DS2两张图，如下
APU_VDDPA 对APU的 VDDR 、VDDP脚位供电
APU_VDDPB 对APU的 VDDR 、UMI模块供
VDDP，徐总意思是PCIE供电，如下图
但感觉还是很模糊，于是找到了APU中北桥的解释 以及GA-A55M-DS2的框架，如下图
因此对APU_VDDPB对UMI模块供电的意思就一目了然了：UMI总线，即APU_VDDPNB为UMI总线供电，而徐总说的 “VDDP----PCIE供电”实际上就是 ”VDDP-----UMI总线供电“
最后VDDR才是 “内存控制器” 供电，由 APU_VDDPA 、APU_VDDPB 供电
附上：徐总A55M时序分析贴直通车：http:///thread-857458-1-1.html
GA-A55M-DS2 1.01 图纸在上面链接有就不上传了
另外，题外话，如下图
图中正下方 Display PPL ，不知道是我看错还是图有误，应该是PLL啊
以上纯属个人理解，如有错误，欢迎大神
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楼主不错，
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楼主应该能与老徐比肩了
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真腻害，楼主自己开店，有没有经验分享的啊
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这么高深的东西 看不懂
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不错，学习了。继续努力
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看了三遍啊才理解，楼主厉害可以搞研发了。 电路 电子 维修 求创维42c08RD电路图 评论 电视的图纸很少见 评论 电视的图纸很少见 评论 创维的图纸你要说 版号，不然无能为力 评论 板号5800-p42ALM-0050 168P-P42CLM-01 电路 电子 维修 我现在把定影部分拆出来了。想换下滚，因为卡纸。但是我发现灯管挡住了。拆不了。不会拆。论坛里的高手拆解过吗？ 评论 认真看，认真瞧。果然有收
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